DDR也就是常称的内存在一般使用过程中都是透明的，此文从多方面对DDR进行详解。
DDR训练
高可靠性是系统级芯片SoC重要的质量和性能要求之一。SoC的复杂在于各个IP模块都对其产生至关重要的影响。从芯耀辉长期服务客户的经验来看，在客户的SoC设计中，访问DDR SDRAM是常见的需求，所以DDR PHY则成为了一个非常关键的IP，其能否稳定可靠的工作决定了整个SoC芯片的质量和可靠性。
制定DDR协议的固态技术协会（JEDEC）标准组织并没有在规范中要求动态随机存取存储器（DRAM）需要具备调整输入输出信号延时的能力，于是通常DDR PHY就承担起了输入和输出两个方向的延时调整工作，这个调整的过程称为训练（training）。
训练是为了使DDR PHY输出信号能符合固态技术协会标准的要求，DDR PHY通过调节发送端的延迟线（delay line），让DRAM颗粒能在接收端顺利地采样到控制信号和数据信号；相对应的，在DDR PHY端，通过调整内部接收端的延迟线，让DDR PHY能顺利地采样到DRAM颗粒的输出信号。从而在读写两个方向，DDR接口都能稳定可靠地工作。
