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xilinx mipi ip
占位
xilinx ip
Xilinx
hls
fpga开发
ip
xilinx ip 图像画框
功能 1 单axi stream 接口输入 10bit raw输入 axis输出 10bit输出 2 使用xilinx hls 编写 3 配置寄存器有 目前最多画10个框 pragma HLS INTERFACE s axilite por
xilinx ip
fpga开发
hls
Xilinx
FPGA
xilinx ip 高斯金字塔down
功能 1 单axi stream 接口输入 10bit raw输入 axis输出 10bit输出 2 使用xilinx hls 编写 3 配置寄存器有 pragma HLS INTERFACE s axilite port width pr
xilinx ip
ip
fpga开发
hls
Xilinx
xilinx ip 高斯滤波
功能 1 单axi stream 接口输入 10bit raw输入 axis输出 10bit输出 使用5x5 的卷积进行滤波 2 使用xilinx hls 编写 3 配置寄存器有 pragma HLS INTERFACE s axilite
xilinx ip
Xilinx
hls
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fpga开发