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二级运放的Cadence仿真

2023-05-16

基于之前做的折叠共源共栅cascode，在后面加两个管子，变成一个简单的二级运放。二级运放的通带内的增益大于80dB，GBW为大于50M，相位裕度大于60°。为了保证运放的相位裕度，在输出的PMOS管的漏栅之间加电阻和电容。设置电容的值为x,电感的值为y，通过扫参确定最佳的GBW和相位裕度。二级运放的原理图如下：
在这里插入图片描述

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仿真稳定性的时候添加analoglib中的iprobe，iprobe所在的支路一定要是个负反馈，并且反馈中不能有激励源，因此将vin与电压源断开。
扫参设置如下：
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仿真结果如下：
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相位裕度为71°，GBW为88M。
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通带内的增益为88dB。

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cadence

二级运放

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