是否可以在 Verilog 中引用/显示信号的名称/文字?
对于在 Verilog 测试台中创建通用信号检查功能来说,这将是一个有用的功能。
我知道使用 $display() 时 %m 将打印信号的范围。是否有显示信号名称的等效项?
在 Verilog 中,唯一的方法是使用 PLI/VPI 编写 C 代码。
在SystemVerilog中,您可以使用引用宏
`define QUOTE(q) `"q`"
`define DISPLAY(me) $display("Signal %s is %h",`QUOTE(me), me)
`DISPLAY(my_signal);
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